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Quaternary CLB a falul tolerant quaternary FPGA
(2012) [Thesis]A diminuição no tamanho dos transistores vem aumentando cada vez mais o número de funções que os dispositivos eletrônicos podem realizar. Apesar da diminuição do tamanho mínimo dos transistores, a velocidade máxima dos ... -
Radiation robustness of XOR and majority voter circuits at finFET technology under variability
(2017) [Dissertation]Advances in microelectronics have contributed to the size reduction of the technological node, lowering the threshold voltage and increasing the operating frequency of the systems. Although it has positive outcomes related ... -
Real-time trace decoding and monitoring for safety and security in embedded systems
(2021) [Thesis]Integrated circuits and systems can be found almost everywhere in today’s world. As their use increases, they need to be made safer and more perfor mant to meet current demands in processing power. FPGA integrated SoCs can ... -
Redução de congestionamento em roteamento global de circuitos VLSI
(2013) [Dissertation]O Roteamento Global é responsável pelo planejamento da distribuição dos meios de interconexão dentro da área do circuito. Dentro da fase do projeto de circuitos conhecida como Síntese Física, essa fase situa-se após a etapa ... -
Reliability evaluation of finFET-based SRAMs in the presence of resistive defects
(2021) [Thesis]The development of Fin Field Effect Transistor (FinFET) has made possible the continuous scaling-down of Complementary Metal-Oxide-Semiconductor (CMOS) technology, overcoming issues caused by the Short-Channel Effects. In ... -
A resource-aware multicore CGRA architecture for edge applications
(2020) [Dissertation]Edge devices on the Internet of Things (IoT) are intelligent, cloud-connected, usually battery-operated systems that are increasing in numbers and that are used in many applications, including smart homes, agriculture, ... -
Roteamento global de circuitos VLSI
(2013) [Dissertation]Este trabalho apresenta a implementação de um roteador global de circuitos integrados capaz de tratar os problemas de roteamento atuais, utilizando como referência para avaliação os circuitos de benchmark publicados durante ... -
SAT based environment for logical capacity evaluation of via configurable block templates
(2016) [Thesis]Structured ASICs with regular layouts comprise a design-based solution for IC manufacturing yield loss in nanometer technologies caused by photolithography distortions. Via-configurable structured ASICs is even a more ... -
Selective software-implemented hardware fault tolerance tecnhiques to detect soft errors in processors with reduced overhead
(2016) [Thesis]Software-based fault tolerance techniques are a low-cost way to protect processors against soft errors. However, they introduce significant overheads to the execution time and code size, which consequently increases the ... -
Simulação litográfica
(2014) [Dissertation]Litografia óptica é o processo pelo qual os padrões desenhados pelos projetistas de circuitos integrados são transferidos para o wafer através de ondas de luz. Com a miniaturização dos componentes, aumenta cada vez mais a ... -
A Simulation-based methodology focused on energy-efficient approximate hardware accelerators design
(2018) [Thesis]The increasing power density and the pervasive use of compute-intensive and power-hungry applications demand energy-efficient CMOS design. This work proposes a systematic simulation-based design flow to explore the integration ... -
Single event transient effects in clock distribution networks
(2014) [Thesis]Technology scaling to semiconductor has increased the radiation-induced susceptibility of electronic devices. Single Event Transient (SET) are becoming increasingly problematic for integrated circuits (ICs). Radiation ... -
Single trimming resistorless CMOS sub-bandgap voltage references for high precision applications
(2021) [Dissertation]A voltage reference is a relevant circuit class since its output voltage should generate an accurate reference for many analog, mixed-signal, and digital applications. This type of circuit works based on the mutual ... -
Síntese automática do leiaute de redes de transistores
(2014) [Thesis]Fluxo de síntese física baseado em standard cells tem sido utilizado na indústria e academia já há um longo período de tempo. Esta técnica é conhecida por ser bastante confiável e previsível uma vez que a mesma biblioteca ... -
Síntese automática do leiaute usando o ASTRAN
(2017) [Dissertation]O trabalho usa a síntese do leiaute através do ASTRAN em circuitos que foram otimizados através da técnica de SCCG (Static CMOS Complex Gates) visando alcançar reduções em número de transistores. A metodologia apresentada ... -
Síntese e caracterização de nanofios de ZnO para aplicações em emissão de campo
(2010) [Dissertation]Neste trabalho, descrevemos o crescimento controlado e alinhado de nanofios de óxido de zinco (ZnO), bem como a análise das propriedades de emissão de campo (Field Emission) destes nanomateriais. Diferentes estratégias de ... -
Síntese e passivação de nanofios de óxido de zinco
(2017) [Dissertation]Neste trabalho se realiza a síntese e caracterização de nanofios de óxido de zinco. Adicionalmente se apresenta o processo de montagem de um dispositivo para medidas elétricas deste material. Estuda-se complementarmente o ... -
Síntese, fotoluminescência e caracterização elétrica de nanoestruturas de ZnO
(2012) [Dissertation]Nanofios semicondutores de óxido metálico apresentam enorme potencial em aplicações de nano-sensoriamento de diferentes gases e substâncias químicas e biológicas, bem como na aplicação a detectores UV-visível. Neste trabalho, ... -
Sistema de spray pirólise com movimento horizontal microcontrolado para deposição de filmes finos de TiO2.
(2020) [Dissertation]Nesta dissertação descrevemos a construção de um equipamento para deposição de filmes finos por spray pirólise para aplicações futuras em fotocatálise. Para demonstrar o funcionamento do equipamento usaremos a deposição ... -
Sistema de tradução binária de dois níveis para execução multi-ISA
(2011) [Dissertation]Atualmente, a adição de uma nova função implementada em hardware em um processador não deve impor nenhuma mudança no conjunto de instruções (ISA – Instruction Set Architecture) suportado para atingir melhorias em seu ...
