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Quaternary CLB a falul tolerant quaternary FPGA
(2012) [Thesis]A diminuição no tamanho dos transistores vem aumentando cada vez mais o número de funções que os dispositivos eletrônicos podem realizar. Apesar da diminuição do tamanho mínimo dos transistores, a velocidade máxima dos ... -
Radiation robustness of XOR and majority voter circuits at finFET technology under variability
(2017) [Dissertation]Advances in microelectronics have contributed to the size reduction of the technological node, lowering the threshold voltage and increasing the operating frequency of the systems. Although it has positive outcomes related ... -
Redução de congestionamento em roteamento global de circuitos VLSI
(2013) [Dissertation]O Roteamento Global é responsável pelo planejamento da distribuição dos meios de interconexão dentro da área do circuito. Dentro da fase do projeto de circuitos conhecida como Síntese Física, essa fase situa-se após a etapa ... -
Roteamento global de circuitos VLSI
(2013) [Dissertation]Este trabalho apresenta a implementação de um roteador global de circuitos integrados capaz de tratar os problemas de roteamento atuais, utilizando como referência para avaliação os circuitos de benchmark publicados durante ... -
SAT based environment for logical capacity evaluation of via configurable block templates
(2016) [Thesis]Structured ASICs with regular layouts comprise a design-based solution for IC manufacturing yield loss in nanometer technologies caused by photolithography distortions. Via-configurable structured ASICs is even a more ... -
Selective software-implemented hardware fault tolerance tecnhiques to detect soft errors in processors with reduced overhead
(2016) [Thesis]Software-based fault tolerance techniques are a low-cost way to protect processors against soft errors. However, they introduce significant overheads to the execution time and code size, which consequently increases the ... -
Simulação litográfica
(2014) [Dissertation]Litografia óptica é o processo pelo qual os padrões desenhados pelos projetistas de circuitos integrados são transferidos para o wafer através de ondas de luz. Com a miniaturização dos componentes, aumenta cada vez mais a ... -
Single event transient effects in clock distribution networks
(2014) [Thesis]Technology scaling to semiconductor has increased the radiation-induced susceptibility of electronic devices. Single Event Transient (SET) are becoming increasingly problematic for integrated circuits (ICs). Radiation ... -
Síntese automática do leiaute de redes de transistores
(2014) [Thesis]Fluxo de síntese física baseado em standard cells tem sido utilizado na indústria e academia já há um longo período de tempo. Esta técnica é conhecida por ser bastante confiável e previsível uma vez que a mesma biblioteca ... -
Síntese automática do leiaute usando o ASTRAN
(2017) [Dissertation]O trabalho usa a síntese do leiaute através do ASTRAN em circuitos que foram otimizados através da técnica de SCCG (Static CMOS Complex Gates) visando alcançar reduções em número de transistores. A metodologia apresentada ... -
Síntese e caracterização de nanofios de ZnO para aplicações em emissão de campo
(2010) [Dissertation]Neste trabalho, descrevemos o crescimento controlado e alinhado de nanofios de óxido de zinco (ZnO), bem como a análise das propriedades de emissão de campo (Field Emission) destes nanomateriais. Diferentes estratégias de ... -
Síntese e passivação de nanofios de óxido de zinco
(2017) [Dissertation]Neste trabalho se realiza a síntese e caracterização de nanofios de óxido de zinco. Adicionalmente se apresenta o processo de montagem de um dispositivo para medidas elétricas deste material. Estuda-se complementarmente o ... -
Síntese, fotoluminescência e caracterização elétrica de nanoestruturas de ZnO
(2012) [Dissertation]Nanofios semicondutores de óxido metálico apresentam enorme potencial em aplicações de nano-sensoriamento de diferentes gases e substâncias químicas e biológicas, bem como na aplicação a detectores UV-visível. Neste trabalho, ... -
Sistema de tradução binária de dois níveis para execução multi-ISA
(2011) [Dissertation]Atualmente, a adição de uma nova função implementada em hardware em um processador não deve impor nenhuma mudança no conjunto de instruções (ISA – Instruction Set Architecture) suportado para atingir melhorias em seu ... -
Sistemas multiprocessados em chip : reconfigurabilidade e heterogeneidade, economia e compatibilidade binária
(2014) [Dissertation]As limitações resultantes do avanço das tecnologias de integração, como o crescente aumento da densidade de potência, levando à necessidade de redução da frequência de operação dos circuitos somados à necessidade de redução ... -
Soft error analysis with and without operating system
(2016) [Dissertation]The complexity of integrated system on-chips as well as commercial processor’s architecture has increased dramatically in recent years. Thus, the effort for assessing the susceptibility to faults due to the incidence of ... -
Static noise margin analysis for CMOS logic cells in near-threshold
(2018) [Dissertation]The advancement of semiconductor technology enabled the fabrication of devices with faster switching activity and chips with higher integration density. However, these advances are facing new impediments related to energy ... -
Study of the hysteretic behavior in ZnO nanoparticle thin-film transistors
(2012) [Dissertation]Nas últimas décadas, o interesse na eletrônica flexível tem aumentado. Sistemas que apresentam benefícios, tais como: baixo custo, melhor desempenho, transparência, confiabilidade e melhores credenciais ecológicas, estão ... -
Tackling the drawbacks of a lagrangian relaxation based discrete gate sizing algorithm
(2018) [Dissertation]The shrink of the devices sizes allows the number of transistors in the integrated circuits to grow, leading to an increase in the leakage power. The discrete gate sizing technique consists in assigning each gate of the ... -
Técnicas de baixo consumo para módulos de hardware de codificação de vídeo H.264
(2011) [Dissertation]Este trabalho trata da aplicação de técnicas de minimização de consumo de potência para blocos digitais para o algoritmo de SAD e o decodificador H.264/AVC Intra-Only. Na descrição de hardware são acrescidas as técnicas ...
